【原报告在线阅读和下载】：20260608【MKList.com】半导体先进封装与光互联技术专题：COUPE引领光电共封装新纪元 | 四海读报

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一、思维导图框架

二、文档详细总结

本报告为国信证券2026年6月8日发布的通信行业半导体先进封装+光互联专题报告，核心围绕台积电COUPE（紧凑型通用光子引擎） 技术，深度解析光电共封装（CPO）产业技术路线、制造工艺、产业链格局与商业化进展。报告指出COUPE凭借颠覆性3D混合键合技术，解决了传统光模块的功耗、带宽瓶颈，已成为AI算力集群光互联的底层主流标准，CPO产业正式迈入规模化放量阶段，行业整体评级为优于大市。

一、核心投资摘要

1. COUPE技术定位
   COUPE是台积电专为硅光子与CPO打造的通用解决方案，采用3D SoIC-X铜-铜混合键合工艺，跳过传统微凸块结构，实现光子集成电路（PIC）与电子集成电路（EIC）原子级高密度互连，从底层突破400G及以上高速场景的信号衰减、功耗瓶颈。
2. 核心性能优势
   同等传输速率下，COUPE较传统微凸块方案功耗降低40%；在交换机系统级应用中，整体光互连功耗可下降70%，能效提升显著。
3. 行业演进趋势
   网络架构从传统前面板可插拔光模块（FPP） → 板载光学（OBO/NPO）→ CPO光电共封装 快速迭代。传统架构已无法满足AI超高带宽需求，CPO成为行业公认终极方案。
4. 商业化落地
   英伟达Quantum-X/Spectrum-X​ 800G/1.6T CPO交换机、博通TH6-Davisson​ 102.4Tbps交换机均全面采用COUPE架构，头部算力厂商规模化采购标志技术正式商用。
5. 投资方向
   优先布局极微间距三维键合设备、亚微米级光学对准设备、具备CPO先进封装/精密器件制造能力的企业。
6. 潜在风险
   AI发展及投资不及预期、行业竞争加剧、全球地缘政治冲突、新技术迭代引发产业链重构。

二、COUPE技术架构演进与底层工艺

（一）光互连三大架构对比

行业光互连方案按集成度逐级升级，功耗、带宽差距显著，CPO综合优势全面领先：

（二）光电集成封装技术路线

行业共分为六大集成形态，技术难度、性能逐级提升，3D异质整合是当前主流最优路线：

1. 2D/2.5D平面封装：PIC与EIC平铺在基板上，传输距离为毫米级，寄生效应、信号延迟无法规避，仅适用于中低速场景。
2. 3D单片集成（EPIC）：光电芯片在同一片晶圆制作，理论性能最优；但光子、电子芯片工艺制程不匹配，制造成本高、良率低，目前仅停留在研发阶段。
3. 3D异质整合（主流）：包含TSV、TGV、混合键合等分支，光电芯片独立制程、垂直堆叠，兼顾工艺兼容性与短传输距离，是COUPE采用的核心路线。

（三）两大核心工艺解析

1. 芯片键合工艺（决定互连密度与功耗）

四种主流三维互连工艺参数与优劣对比：
| 工艺类型 | 互连间距 | 互连机制 | 核心优势 | 局限性 |
| —- | —- | —- | —- |
| 混合键合（Hybrid） | ＜10μm | Cu-Cu原子级直接键合、无凸块 | 功耗极低、互连密度极高、信号损耗小 | 工艺难度大，对晶圆平整度、洁净度要求极高 |
| 热压键合（TCB） | 2040μm | 微凸块热熔连接 | 工艺成熟，广泛应用于HBM | 易产生电迁移、热应力管控难 || TSV硅通孔 | 1050μm | 硅衬底穿孔填充金属 | 传输路径大幅缩短 | 高频损耗大、散热压力高 |
| TGV玻璃通孔 | ＞30μm | 玻璃基板穿孔填充金属 | 介电损耗低、热膨胀系数可调 | 玻璃脆性大，加工与良率管控难 |

台积电COUPE选用混合键合，是目前高密度、低功耗场景的最优解。

2. 光耦合工艺（决定光信号传输损耗）

负责光纤与光子芯片对接，分为两大主流方案，适配不同应用场景：
| 耦合方式 | 耦合方向 | 耦合损耗 | 带宽范围 | 适配场景 |
| —- | —- | —- | —- |
| 光栅耦合（GC） | 垂直/平面 | -3-5dB（损耗偏高） | 3060nm | 高密度阵列、自动化量产 |
| 端面耦合（EC） | 侧向/水平 | -1~-2dB（损耗低） | ＞100nm | 高性能、低损耗链路 |

（四）台积电COUPE核心壁垒

台积电依托先进封装+硅光工艺双重优势，构筑难以复制的护城河，分为三大维度：

1. 底层工艺壁垒
   采用SoIC-X无凸块铜-铜混合键合，要求晶圆原子级平坦化（CMP）与超高洁净度，传统封测厂（OSAT）难以跨越前道制造门槛；I/O密度较传统封装提升上千倍，满足极限算力吞吐需求。
2. 商业与生态壁垒

• 客户绑定：英伟达、博通等头部芯片厂商深度融入台积电CoWoS/SoIC流水线，供应链切换成本极高；
• EDA协同：联合新思科技、Ansys打造专属COUPE仿真平台，提前解决热管理、电磁干扰问题，在设计阶段锁定客户；
• 专利领先：2024年台积电硅光子核心专利数量达到传统巨头英特尔的近两倍，逐步掌握行业底层物理标准。

3. 性能壁垒
   同等速率下功耗降低40%，同等功耗下传输速度提升170%，交换机系统整体光互连功耗下降70%，综合性能大幅领先竞品。

三、CPO封测制造流程与核心设备

（一）完整封测工艺流程

CPO封装复杂度远高于传统光模块，全流程分为晶圆制造→背面加工→切割→三维键合→共封装→多级测试六大环节，并设置四大关键测试节点层层筛选良率：

1. 晶圆前道+背面工艺：完成TSV、RDL布线、晶圆减薄（至约100μm）；
2. 晶圆切割：采用机械刀轮/飞秒激光划片；
3. PIC-EIC三维键合：核心工序，完成光电芯片堆叠；
4. 光子引擎与交换ASIC共封装：倒装贴装至基板；
5. 四级测试：晶圆级光学测试→切割后裸晶（KGD）筛选→模块级电学测试→最终光链路测试（验证误码率、眼图、插入损耗）。

（二）各环节核心设备及海外主力厂商

（三）三大高壁垒工艺环节

1. PIC-EIC三维键合：需解决光电芯片材质、功耗差异带来的热应力失配，同时保证界面极致平整度，是CPO最核心的技术卡点。
2. FAU光纤阵列贴装：光纤与芯片对准偏差仅0.5μm就会造成显著插入损耗，要求亚微米级对准精度，光学胶固化、高温稳定性要求严苛。
3. 交换ASIC与光引擎共封装：交换ASIC发热量可达数百上千瓦，与温度敏感的光引擎共基板，面临基板翘曲、散热双重难题。

四、产业链各环节厂商布局

（一）全球头部厂商（全产业链核心玩家）

1. 台积电：COUPE架构发明者、硅光前道代工+3D混合键合核心供应商，掌握最顶层技术；
2. 日月光（ASE）：全球第一大封测厂，擅长晶圆级扇出、大基板翘曲管控，承接大量CPO共封装订单；
3. 新思科技：联合台积电打造COUPE专属EDA仿真平台，支撑光电协同设计；
4. 专用设备商：EVG（混合键合）、韩美半导体（热压键合）、ficonTEC（光学组装）、FormFactor/Teradyne（测试），垄断高端设备市场；
5. 博通：高端交换ASIC供应商，定义光子引擎参考设计，系统级热设计能力突出。

（二）国内细分赛道厂商

国内厂商围绕硅光代工、先进封测、专用设备、测试、材料五大方向布局，逐步切入CPO供应链：

1. 硅光代工&传统封测：中芯国际、长电科技、通富微电、华天科技，依托2.5D/3D封装平台拓展硅光业务；
2. 光学组装设备：罗博特科（收购ficonTEC）、博众精工，主攻亚微米光学对准设备；
3. 三维键合&薄膜设备：拓荆科技、微导纳米，国产混合键合设备处于客户验证阶段；
4. 前道制程设备：中微公司、北方华创、芯源微、芯碁微装，覆盖刻蚀、光刻、涂胶等环节；
5. 测试设备：华峰测控、长川科技，从传统元器件测试向光电联合测试升级；
6. 工艺材料：江丰电子（高纯靶材）、鼎龙股份（CMP抛光材料），提供底层耗材支撑。

五、标杆产品商业化案例

1. 英伟达 Quantum-X / Spectrum-X 交换机
   基于台积电COUPE架构的800G/1.6T纯血CPO交换机，光引擎采用7nm EIC+65nm PIC三维堆叠，摒弃传统DSP芯片，插入损耗从22dB降至4dB，网络能效提升5倍，已实现量产落地。
2. 博通 TH6-Davisson 交换机
   整机带宽达102.4Tbps，采用COUPE光引擎+先进多芯片封装，系统光互连功耗较传统可插拔方案降低70%，面向超大规模AI集群，是当前带宽最高的CPO交换机产品。

六、投资建议

当前以COUPE为代表的3D光电共封装技术处于产业化加速拐点，头部AI算力客户订单持续落地。建议重点关注两类企业：

1. 核心设备厂商：掌握极微间距三维键合设备、亚微米级光学主动对准设备的企业；
2. 先进封装厂商：具备CPO封装、精密无源器件制造能力的封测与集成企业。

七、风险提示

1. AI需求不及预期：全球AI产业发展、资本投入放缓，导致CPO/硅光产品订单下滑；
2. 行业竞争加剧：国内外厂商集中入局，引发产品价格战、利润压缩；
3. 地缘政治风险：全球供应链摩擦，影响设备、芯片、技术流通；
4. 技术迭代风险：新兴封装/光互联技术出现，改变现有产业链格局。